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申请/专利权人：英特尔公司
摘要：一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
主权项：1.一种计算装置，包括：互连结构；存储器接口，其耦合到所述互连结构；输入输出IO单元，其耦合到所述互连结构；多处理器阵列，其耦合到所述互连结构，所述多处理器阵列中的一个多处理器用于跨多个线程并行地执行混合精度指令，所述多处理器阵列中的多处理器包括：多个寄存器，其用于存储压缩浮点操作数值；以及执行逻辑单元，其用于执行所述混合精度指令中的一个或多个，以执行融合乘-累加操作，所述执行逻辑单元包括：16位乘法器，其用于将第一16位浮点源值与第二16位浮点源值相乘，以生成中间结果；以及32位累加器，其用于将所述中间结果与累加的浮点值相加，以生成新的累加结果。
全文数据：
权利要求：
百度查询： 英特尔公司 用来执行用于机器学习的浮点和整数操作的指令和逻辑
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