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申请/专利权人：山东浪潮科学研究院有限公司
摘要：本发明公开一种基于FPGA的UART接口模块及设计方法，涉及UART通信技术领域，方法包括：波特率发生器通过边沿检测和低电平时间计算来确定波特率值，并将其与预设的波特率表进行比对来自动配置校准串口的波特率；波特率发生器计算出波特率后，通过对系统时钟进行分频生成采样的信号，以接收配置码并存到移位寄存器中，该移位寄存器可以被接收单元访问，接收单元将串行数据转换为并行数据；发送单元在参数配置完成后，根据移位寄存器中的参数信息来控制数据的发送状态时序，确保数据按照正确的格式和速率发送，以将并行数据转换成串行形式发送出去。本发明可以实现波特率的自动配置校准和数据格式的自动调整，无需提前建立波特率。
主权项：1.一种基于FPGA的UART接口模块，其特征在于，其包括：波特率发生器，用于通过边沿检测和低电平时间计算来确定波特率值，并将其与预设的波特率表进行比对来自动配置校准串口的波特率；还用于波特率发生器计算出波特率后，通过对系统时钟进行分频生成采样的信号，以接收配置码并存到移位寄存器中；接收单元，用于访问移位寄存器，将串行数据转换为并行数据；发送单元，用于在参数配置完成后根据移位寄存器中的参数信息来控制数据的发送状态时序，确保数据按照正确的格式和速率发送，以将并行数据转换成串行形式发送出去。
全文数据：
权利要求：
百度查询： 山东浪潮科学研究院有限公司 一种基于FPGA的UART接口模块及设计方法
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