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申请/专利权人：思瑞浦微电子科技(上海)有限责任公司
摘要：本发明公开了一种低延迟GPIO通信系统，包括：多个相连的节点，节点包括：一个或多个用于与外围设备相连的GPIO端口；各节点用于将自身的一个或多个GPIO端口上的GPIO数据转化为本地GPIO数据，任意两个所述节点中的上游节点用于将自身的本地GPIO数据并与下游节点的本地GPIO数据或GPIO确认数据进行确认产生当前GPIO确认数据。根据本发明的低延迟GPIO通信系统及通信方法，通过在各节点中进行逐级确认形成低延迟的GPIO通信，从而无需主节点和外围设备过度参与，降低系统通信延迟，并降低了系统设计的复杂性。该方案成本代价低，易于实现，其只需要一些基本门级电路搭建，消耗资源较少，实现代价低；且可控制程度高，配置灵活。
主权项：1.一种低延迟GPIO通信系统，其特征在于，包括：多个相连的节点，所述节点包括：一个或多个用于与外围设备相连的GPIO端口，所述节点通过GPIO端口与外围设备进行通信；其中，各所述节点用于将自身的一个或多个GPIO端口上的GPIO数据转化为本地GPIO数据，任意两个所述节点中的上游节点用于将自身的本地GPIO数据并与下游节点的本地GPIO数据或GPIO确认数据进行确认产生当前GPIO确认数据。
全文数据：
权利要求：
百度查询： 思瑞浦微电子科技(上海)有限责任公司 低延迟GPIO通信系统及通信方法
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