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申请/专利权人：北京华航无线电测量研究所
申请日：2022-12-05
公开（公告）日：2024-06-07
公开（公告）号：CN118154402A
主分类号：G06T1/20
分类号：G06T1/20;G06T1/60;G06T7/11
优先权：
专利状态码：在审-公开
法律状态：2024.06.07#公开
摘要：本发明涉及一种基于FPGA的多级池化系统，属于深度学习智能算法技术领域，解决了现有技术中基于FPGA的多级池化的资源消耗多、处理难度大的问题。该系统包括：池化控制模块，根据池化级数生成池化指令；动态随机存储器分为A区和B区，根据池化指令实现A区、B区在分割区与池化结果存储区间的切换；分割区对当前池化级数对应的待处理图像按行进行分割，并按行顺序存储分割后的子图像；每M行子图像作为一组待处理子图像；池化模块，将分割区的每一组待处理子图像中的M行子图像通过一一对应的M个输入接口输入到块状存储单元；块状存储单元对块状存储单元中数据进行池化处理，并将池化结果输出到池化结果存储区。
主权项：1.一种基于FPGA的多级池化系统，其特征在于，包括：池化控制模块，用于根据池化级数，生成指向动态随机存储器的池化指令；动态随机存储器，分为A区和B区；动态随机存储器根据所述池化指令，实现A区、B区在分割区与池化结果存储区之间的相互切换；其中，所述分割区，用于对当前池化级数对应的待处理图像按行进行分割，并按行顺序依次存储分割后的子图像；从第一行开始，每M行子图像作为一组待处理子图像；池化核的尺寸为M×M；所述池化结果存储区用于存储池化结果；池化模块，包括M个输入接口、尺寸为M×M的块状存储单元、一个输出接口；将分割区的每一组待处理子图像中的M行子图像通过一一对应的M个输入接口输入到块状存储单元；块状存储单元每接收到M列数据，对块状存储单元中的M×M个数据进行池化处理，并将池化结果通过输出接口输出到池化结果存储区。
全文数据：
权利要求：
百度查询： 北京华航无线电测量研究所 一种基于FPGA的多级池化系统
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