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申请/专利权人：北京华航无线电测量研究所
申请日：2022-12-05
公开（公告）日：2024-06-14
公开（公告）号：CN118196463A
主分类号：G06V10/764
分类号：G06V10/764;G06V10/26;G06F15/78
优先权：
专利状态码：在审-公开
法律状态：2024.06.14#公开
摘要：本发明涉及基于FPGA的多级池化方法，属深度学习智能算法领域，解决了现有多级池化的资源消耗多的问题。方法包括：将动态随机存储器分为A区和B区，将第一级池化级数对应的待处理图像发送到A区；每执行一级池化级数对应的池化处理，执行：生成池化指令：当池化级数为奇数时控制A区为分割区、B区为池化结果存储区；偶数反之；动态随机存储器根据池化指令配置A区和B区；利用分割区对当前池化级数对应的待处理图像按行进行分割，并按行顺序存储分割后的子图像；对每一组待处理子图像进行池化处理，得到池化结果；将池化结果存储在池化结果存储区，并作为下一级池化级数对应的待处理图像；跳转至执行下一级池化处理。
主权项：1.一种基于FPGA的多级池化方法，其特征在于，包括：将动态随机存储器分为A区和B区，将第一级池化级数对应的待处理图像发送到A区；每执行一级池化级数对应的池化处理，执行：生成匹配于当前池化级数的池化指令；所述池化指令用于：当池化级数为奇数时，控制A区为分割区、B区为池化结果存储区；当池化级数为偶数时，控制A区为池化结果存储区、B区为分割区；动态随机存储器根据所述池化指令配置A区和B区；利用分割区对当前池化级数对应的待处理图像按行进行分割，并按行顺序依次存储分割后的子图像；从第一行开始，每M行子图像作为一组待处理子图像；池化核的尺寸为M×M；对每一组待处理子图像进行接收及池化处理，得到池化结果；将各组待处理子图像输出的池化结果存储在池化结果存储区，并作为下一级池化级数对应的待处理图像；跳转至执行下一级池化级数对应的池化处理的步骤，直至最后一级池化级数。
全文数据：
权利要求：
百度查询： 北京华航无线电测量研究所 一种基于FPGA的多级池化方法
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