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申请/专利权人：湖南艾科诺维科技有限公司
申请日：2024-03-22
公开（公告）日：2024-06-21
公开（公告）号：CN118233271A
主分类号：H04L27/26
分类号：H04L27/26
优先权：
专利状态码：在审-公开
法律状态：2024.06.21#公开
摘要：本发明公开了一种FPGA资源优化的位同步方法及系统，方法包括以下步骤：获取预处理后的基带信号，提取基带信号的符号位，将符号位与本地序列采用补码配对相减匹配滤波法进行粗同步互相关，若得到粗同步脉冲，根据粗同步脉冲产生指引脉冲；在指引脉冲附近通过滑动寄存器将本地序列与预处理后的基带信号进行精同步互相关，若得到精同步脉冲，根据精同步脉冲的时钟生成位同步时钟，并根据精同步脉冲的时钟更新下一指引脉冲的时钟，若连续未得到精同步脉冲的次数小于预设阈值，根据指引脉冲的时钟更新下一指引脉冲的时钟，若连续未得到精同步脉冲的次数大于预设阈值，重新捕获粗同步脉冲。本发明利用粗同步捕获和精同步跟踪的方式有效权衡补码配对相减匹配滤波法与滑动寄存器二者的矛盾，能够大量节省FPGA资源。
主权项：1.一种FPGA资源优化的位同步方法，其特征在于，包括以下步骤：S101获取预处理后的基带信号，提取所述基带信号的符号位，将所述符号位与本地序列采用补码配对相减匹配滤波法进行粗同步互相关，若得到粗同步脉冲，根据粗同步脉冲产生指引脉冲；S102在指引脉冲附近通过滑动寄存器将本地序列与预处理后的基带信号进行精同步互相关，若得到精同步脉冲，根据精同步脉冲的时钟生成位同步时钟，并根据精同步脉冲的时钟更新下一指引脉冲的时钟，若未得到精同步脉冲，将指引脉冲作为精同步脉冲，若连续未得到精同步脉冲的次数大于预设阈值，跳转执行步骤S101重新捕获粗同步脉冲。
全文数据：
权利要求：
百度查询： 湖南艾科诺维科技有限公司 一种FPGA资源优化的位同步方法及系统
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