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用于锁相环路中精细控制相位/频率偏移的方法和电路 

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申请/专利权人:模拟比特公司

摘要:实现方式提供了一种锁相环路PLL装置,包括:相位和频率检测器PFD与电荷泵CP部分;低通滤波器;压控振荡器VCO,所述VCO由所述低通滤波器驱动以生成VCO时钟信号;多个分频器,被配置来接收所述VCO时钟信号并分阶段对所述VCO时钟信号进行分频以生成一系列静态分频的VCO时钟信号和动态分频的VCO时钟信号;反馈部分,所述反馈部分包括:第一组件,被配置来接收所述动态分频的VCO时钟信号并生成指示器信号;以及第二组件,被配置来根据所述指示器信号进行多路复用以生成用于所述PFD与CP部分的反馈时钟信号集;以及主相位频率控制引擎,被配置来断言对至少一个分频器的分频控制和对多路复用网络的多路复用控制。

主权项:1.一种锁相环路PLL装置,包括:相位和频率检测器PFD与电荷泵CP部分,所述相位和频率检测器PFD与电荷泵CP部分被配置来i接收参考时钟信号和反馈时钟信号集,并且ii基于所述参考时钟信号与所述反馈时钟信号集之间的差生成输出信号;低通滤波器,所述低通滤波器被配置来从所述相位和频率检测器PFD与电荷泵CP部分接收所述输出信号;压控振荡器VCO,所述压控振荡器VCO由所述低通滤波器驱动以生成VCO时钟信号;第一分频器,所述第一分频器被配置来接收所述VCO时钟信号,并且按第一静态因子对所述VCO时钟信号进行分频以生成第一静态分频的VCO时钟信号;第二分频器,所述第二分频器被配置来接收所述第一静态分频的VCO时钟信号,并且按第二静态因子对所述第一静态分频的VCO时钟信号进行进一步分频以生成第二静态分频的VCO时钟信号,所述第二静态分频的VCO时钟信号能够用作所述锁相环路PLL装置的输出信号;第三分频器,所述第三分频器被配置来接收所述第一静态分频的VCO时钟信号,并且能够在第一动态分频比与第二动态分频比之间对所述第一静态分频的VCO时钟信号进行分频以生成第三静态分频的VCO时钟信号;反馈部分,所述反馈部分包括:第一组件,所述第一组件:i由所述VCO时钟信号或具有相位变化但不具有分频的所述VCO时钟信号记时,并且ii被配置来接收所述第三静态分频的VCO时钟信号并生成指示器信号;以及第二组件,所述第二组件被配置来接收所述指示器信号,并且根据所述指示器信号进行多路复用以便以时钟粒度生成用于所述相位和频率检测器PFD与电荷泵CP部分的所述反馈时钟信号集,所述时钟粒度由所述VCO时钟信号而不是由其分频确定;以及主相位频率控制引擎,所述主相位频率控制引擎被配置来断言对所述第三分频器的第一分频控制和对多路复用网络的第二多路复用控制。

全文数据:

权利要求:

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