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申请/专利权人：中国航空无线电电子研究所
摘要：本发明公开了一种基于时钟对齐与同步的双处理器锁步系统，主控CPU与监控CPU的配置如下：由同源时钟模块驱动主控CPU与监控CPU同时上电复位；分别在ModuleOS入口处、MajorFrame开始处、分区切换开始处设时钟对齐检测点，由监控CPU通过PCIe总线或以太网向主控CPU发送时间戳，由主控CPU进行比对，若发现主控CPU与监控CPU的时钟漂移累积为t，超过精度要求所设阈值，则在运行超前CPU的DEC定时器中断处理函数中增加步长t，使得下一次时钟中断时，主控CPU和监控CPU的系统时间戳对齐同步。本发明取消了处理器外围扩展的同步校对硬件，以较低的成本实现10‑9级的高完整性需求。
主权项：1.一种基于时钟对齐与同步的双处理器锁步系统，包含同源时钟模块、主控CPU、监控CPU，其特征在于：主控CPU与监控CPU的配置如下：a、主控CPU与监控CPU的锁相环模块接同源时钟模块，使同源时钟模块驱动主控CPU与监控CPU同时上电复位；b、主控CPU与监控CPU上运行VxWorks653操作系统，在ModuleOS入口处设置第一次时钟对齐检测点，使主控CPU与监控CPU同时进ModuleOS；c、每个MajorFrame周期开始处设置时钟对齐检测点，使主控CPU与监控CPU每次同时启动新一轮分区调度；其中，MajorFrame是VxWorks653调度的主时间框架，MajorFrame的第一个分区设计为空分区；d、MajorFrame周期内的分区切换开始处再次设置时钟对齐检测点，使主控CPU与监控CPU每次同时启动分区切换；e、在每个时钟对齐检测点，由监控CPU通过PCIe总线或以太网向主控CPU发送时间戳，由主控CPU进行比对，若发现主控CPU与监控CPU的时钟漂移累积为t，超过精度要求所设阈值，则在运行超前CPU的DEC定时器中断处理函数中增加步长t，使得下一次时钟中断时，主控CPU和监控CPU的系统时间戳对齐同步。
全文数据：
权利要求：
百度查询： 中国航空无线电电子研究所 一种基于时钟对齐与同步的双处理器锁步系统
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