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申请/专利权人：深存科技(无锡)有限公司
摘要：本申请公开近IO流水计算的加速器架构和AI加速系统，涉及加速器领域，多通道直接访问模块包含N个DRAM控制器，N个DRAM控制器与DRAM一一对应连接；每个DRAM控制器至少连接K个DMA控制器，并通过DMA控制器连接到对应的核组群；流水同步环与N个核组群连接，包含M个级联的前向传输块和M个级联的后向传输块，首端前向传输块和尾端前向传输块分别连接数据接收模块和数据发送模块；尾端前向传输块的输出级联首个后向传输块；第i个前向传输块和第M‑i个后向传输块前后对应，并共同连接至少一个计算核组。该架构的加速器取代了传统多级cache结构，降低了多层搜索造成的时延，加快加速器内部和加速器之间的计算速率。
主权项：1.一种近IO流水计算的加速器架构，其特征在于，加速器包括多通道直接访问模块、M个计算核组和流水同步环；其中的M个计算核组划分成N个包含相同或不同核组数量的核组群；所述多通道直接访问模块包含N个DRAM控制器，N个所述DRAM控制器与外部的DRAM一一对应连接；每个所述DRAM控制器至少连接K个直接访问存储DMA控制器，并通过所述DMA控制器连接到对应的核组群，将第i个DRAM中的数据直接读取至第i个计算核组群，以及将第i个计算核组群输出的结果数据直接缓存至第i个DRAM；所述流水同步环与N个核组群连接，包含M个级联的前向传输块和M个级联的后向传输块，尾端前向传输块的输出级联首个后向传输块；第i个前向传输块和第M-i+1个后向传输块前后对应，并共同连接至少一个计算核组；所述前向传输块包含前向寄存器、前向接收单元和前向写入单元，后向传输块包含后向寄存器和后向写入收单元；前向接收单元接收计算核组输入的数据，以流水形式送入所述流水同步环，前向写入单元和后向写入单元将数据以流水形式推向目标计算核组；其中的M，N，K，i是正整数。
全文数据：
权利要求：
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