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基于FPGA的低开销超宽带数字波束形成方法和系统 

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申请/专利权人:西安欣创电子技术有限公司

摘要:本发明公开了一种基于FPGA的低开销超宽带数字波束形成方法和系统,包括:将各数字通道接收的宽带数字信号宽带均衡处理后输入对应的分数延时滤波器组做小数延时处理,并得到该数字通道各分数延时滤波器的输出信号编码结果;针对每个波束指向,计算N个数字通道的延时量、整数延时量和小数延时量并对小数延时量量化编码,得到各数字通道对应的小数延时量量化编码结果;在所有数字通道各分数延时滤波器的输出信号编码结果中确定各数字通道匹配的分数延时滤波器的输出信号,整数延时处理后得到对应的幅相加权信号;将该波束指向时所有数字通道的幅相加权信号相加输出,从而得到M个波束输出信号;本发明可形成多数量宽带波束,节约FPGA资源。

主权项:1.一种基于FPGA的低开销超宽带数字波束形成方法,其特征在于,应用于FPGA,所述方法包括:针对N个数字通道,将每个数字通道接收到的宽带数字信号进行宽带均衡处理,以实现所有数字通道频带内信号的幅相一致性校准,输出各数字通道的均衡处理后信号;针对每个数字通道,将其均衡处理后信号输入该数字通道所对应的分数延时滤波器组,利用其中多个分数延时滤波器各自的延迟量进行小数延时处理,并将每个分数延时滤波器的输出信号进行编码,得到该数字通道各分数延时滤波器的输出信号编码结果;其中,所述分数延时滤波器采用FIR滤波器实现;每个数字通道的分数延时滤波器组中包括11个分数延时滤波器,每个分数延时滤波器的延时量表示为:;表示分数延时滤波器的编号,针对11个分数延时滤波器,取值为0~10;表示系统时钟周期;表示乘法;针对M个波束指向要求中的每个波束指向,计算该波束指向时N个数字通道的延时量、整数延时量和小数延时量,并对所述小数延时量进行量化编码,得到该波束指向时各数字通道对应的小数延时量量化编码结果;其中,N和M为大于0的自然数;对所述小数延时量进行量化编码,采用的公式为: ;表示指定位数四舍五入的函数;表示该波束指向时N个数字通道的小数延时量;根据该波束指向时各数字通道对应的小数延时量量化编码结果,在所有数字通道各分数延时滤波器的输出信号编码结果中,确定出每个数字通道匹配的分数延时滤波器的输出信号,继而利用该波束指向时对应数字通道的整数延时量进行整数延时处理,输出该波束指向时对应数字通道的延时后数据;根据信号的载波频率和该波束指向时N个数字通道的延时量,计算该波束指向时N个数字通道的权值系数;将该波束指向时每个数字通道的延时后数据和对应数字通道的权值系数进行复数相乘,得到该数字通道的幅相加权信号;将该波束指向时所有数字通道的幅相加权信号相加,得到该波束指向的输出信号,从而得到M个波束指向的输出信号。

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