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申请/专利权人：华中科技大学
摘要：本发明公开了一种存内计算系统，属于集成电路技术领域；本发明包括存内计算模块、存储模块和缓存模块；存内计算模块包括n个并行的存内计算单元，用于一一对应实现预设神经网络的n个网络层的运算；n≥1；缓存模块包括：缓存控制单元、n个缓存通道和互连网络结构；当某一存内计算单元A所需的数据由存内计算单元B产生时，则将存内计算单元B产生的数据暂存在对应的缓存通道中，在存内计算单元A需要时，该数据通过互连网络结构从存内计算单元B对应的缓存通道传输至存内计算单元A对应的缓存通道，进而传送至存内计算单元A，该过程不用经过内存模块进行交互，降低了数据传输开销，传输效率较高，提高了神经网络在存内计算系统的计算效率。
主权项：1.一种存内计算系统，其特征在于，包括：存内计算模块、存储模块和缓存模块；所述存内计算模块包括n个并行的存内计算单元，用于一一对应地实现预设神经网络的n个网络层的运算；所述存储模块用于存储n个网络层的待运算数据；n≥1；所述缓存模块包括：缓存控制单元、n个缓存通道和互连网络结构；n个所述缓存通道与n个存内计算单元一一对应相连；所述互连网络结构用于将n个所述缓存通道两两交叉相连；所述缓存通道包括：第一输入端、第一输出端、第二输入端和第二输出端；所述缓存控制单元用于根据所述预设神经网络不同网络层间的数据流动关系，获取每个存内计算单元的下游存内计算单元，进而确定每个所述缓存通道的下游缓存通道，并进行如下控制：当所述存储模块中存在第i个网络层的待运算数据时，控制第i个所述缓存通道通过其第一输入端从所述存储模块中获取第i个网络层的待运算数据，缓存后通过第一输出端输出至第i个存内计算单元中；在第i个存内计算单元完成一次运算后，控制第i个所述缓存通道通过其第二输入端接收第i个存内计算单元的运算结果，缓存后通过所述互连网络结构传输至对应的下游缓存通道，通过该下游缓存通道的第二输出端输出至对应的存内计算单元；i=1,2,...,n。
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