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申请/专利权人：东南大学

摘要：本发明公开一种应用于模拟存内计算的逐次逼近型模数转换器电路，包括：8位电荷再分配型数模转换器电路、带启动电路的电流偏置电路、运放控制的电压模基准电路、高速锁存比较器电路和实现二进制搜索算法的逐次逼近逻辑控制模块。电流偏置电路连连接基准电路、基准电路后附加的缓冲电路以及比较器电路；数模转换器电路由数字逻辑控制模块控制数字输入，利用高速锁存比较器对模拟输入和基准电压进行比较，根本比较结果反馈到数模转换器的数字输入进行调整。本发明对逐次逼近型模数转换器电路中的电流偏置模块、带隙基准模块进行了有效的漏电控制，降低了静态功耗，对比较器模块应用输出失调存储技术，提高了模数转换器的线性度。

主权项：1.一种应用于模拟存内计算的逐次逼近型模数转换器电路，其特征在于，该电路包括以下模块：8位电荷再分配型数模转换器电路、带启动电路的电流偏置电路、运放控制的电压模基准电路、高速锁存比较器电路和一个实现二进制搜索算法的逐次逼近逻辑控制模块；所述电流偏置电路连接电压模基准电路，电压模基准电路后附加的缓冲电路以及高速锁存比较器电路，提供电流或电压偏置；所述数模转换器电路由逐次逼近逻辑控制模块控制数字输入，并利用高速锁存比较器电路对模拟输入和基准电压进行比较，根本比较结果反馈到数模转换器电路的数字输入进行调整，最终以二进制搜索算法的形式实现逐次逼近的模数转换功能；所述高速锁存比较器电路，由三级锁存比较级和一级输出缓冲级构成，三级锁存比较级为结构相同的静态锁存电路，其作用为将输入比较器正端的模拟电压与负端的共模电平比较判定，然后输出逻辑电平；输出缓冲级电路为一个简单的差分运放，为高速锁存比较器电路提供足够的增益和输出稳定的逻辑电平；所述高速锁存比较器的四级电路之间，应用输出失调存储OOS技术，开关S1~S4均由两对互补CMOS开关构成，开关S1~S4的一端都连接共模电平VCOM，开关S1~S4另一端分别连接比较器四级电路的正负输入端；所述高速锁存比较器的第一锁存比较级的负输出端与第二锁存比较级的正输入端以电容C1耦合，第一锁存比较级的正输出端与第二锁存比较级的负输入端以电容C2耦合，第二锁存比较级的负输出端与第三锁存比较级的正输入端以电容C3耦合，第二锁存比较级的正输出端与第三锁存比较级的负输入端以电容C4耦合，第三锁存比较级的负输出端与输出缓冲级的负输入端以电容C5耦合，第三锁存比较级的正输出端与输出缓冲级的正输入端以电容C6耦合。

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百度查询： 东南大学 一种应用于模拟存内计算的逐次逼近型模数转换器电路