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申请/专利权人：三星显示有限公司
申请日：2023-12-20
公开（公告）日：2024-06-25
公开（公告）号：CN118248063A
主分类号：G09G3/20
分类号：G09G3/20;G09G3/32;G09G3/3266
优先权：["20221223 KR 10-2022-0183213"]
专利状态码：在审-公开
法律状态：2024.06.25#公开
摘要：提供了一种栅极驱动电路，通过在下拉晶体管输出低电平电压的栅极信号和进位信号的情况下使截止的晶体管的漏电流最小化，可以从该栅极驱动电路输出稳定的栅极信号。该栅极驱动电路中的一些晶体管包括串联的两个晶体管以减小截止状态下的漏电流，并且还包括电容器以减小漏电流。因此，可以更好地控制节点处的电压，从而可以稳定地控制输出栅极电压和进位电压。
主权项：1.一种栅极驱动电路，所述栅极驱动电路包括：多个级，每个级包括：节点控制器，控制第一节点的电压电平和第二节点的电压电平；第一输出部，根据所述第一节点的电压电平和所述第二节点的电压电平输出栅极信号，所述栅极信号具有第一电平的电压或第二电平的电压，所述第二电平低于所述第一电平；第二输出部，根据所述第一节点的电压电平和所述第二节点的电压电平输出进位输出信号，所述进位输出信号具有所述第一电平的电压或第三电平的电压，所述第三电平低于所述第二电平，其中，所述节点控制器包括：第一稳定晶体管和第二稳定晶体管，串联电连接在所述第一节点与被施加所述第三电平的电压的电压输入端子之间；以及第一电容器，电连接在所述第一稳定晶体管与所述第二稳定晶体管之间，所述第一稳定晶体管电连接在所述第一节点与所述第一电容器之间，并且包括与被施加第一时钟信号的第一时钟输入端子电连接的栅极，并且所述第二稳定晶体管电连接在所述第一电容器与被施加所述第三电平的电压的电压输入端子之间，并且包括与所述第二节点电连接的栅极。
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