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一种FPGA端口扩展的方法 

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申请/专利权人:上海思尔芯技术股份有限公司

摘要:本发明公开了一种FPGA端口扩展的方法,通过对每个FPGA的外部连接接口进行统一处理,利用FPGA厂家提供的底层高速数据串并转换IP模块,采用TDM技术,生成新的顶层,自动加入每个FPGA的数据收发模块。根据用户设定的数据信号传输比例,自动封装厂家提供的底层高速数据传输IP,在多个FPGA之间快速的传递大量的设计信号,整个设计的逻辑功能运行正确,运行期性能达到最优。在异步TDM模式中,对数据采样进行数据同步处理,确保数据在采样的过程不会产生亚稳态,保证了数据的稳定传输。用户利用本发明提供的方法可以快速,方便地开发、设计基于多块FPGA的大容量、复杂程度高的芯片设计,加快SOC产品的开发流程。

主权项:1.一种FPGA端口扩展的方法,其特征在于,包括如下步骤:步骤1、对用户的芯片设计编译为统一的数据格式的网表;步骤2、根据用户设定的TDM传输的模式及参数,对用户设计和厂家的底层传输IP进行自动连接,封装处理,生成新的FPGA的逻辑设计及设置;步骤3、使用用户时钟产生一个用户时钟的二分频信号,所述二分频信号的上升沿和下降沿的总和等于用户时钟的频率;步骤4、使用Serdes的时钟对用户时钟的二分频信号打两拍产生同步信号1和同步信号2;步骤5、使用Serdes的时钟在同步信号2的上升沿和下降沿对用户数据进行采样,采样频率等于用户时钟的频率;步骤6、将采样后的数据根据FPGA类型转换为专用门电路网表库文件,和配置约束信息;步骤7、经过EDA专用的布线工具处理,生成可配置于FPGA的比特流文件;所述步骤5中用户数据每次在采样之前会进行CRC校验,先将用户数据进行异或,并将校验的结果记作CRC0,接着将采样稳定的用户数据通过Serdes单bit的发送出去,Serdes接收端会在下一个用户时钟上升沿采样到上一个时钟发送的数据,并将CRC数据校验的结果记作CRC1,比较CRC0和CRC1的校验结果判断本次数据TDM传输是否出现了错误。

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