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申请/专利权人：上海芯炽科技集团有限公司

摘要：本发明公开一种用于MIPIAPHY芯片的协议层及协议适配层自测电路，属于测试电路领域，包括协议层、协议适配层、MIPIAPHY链路层和MIPIAPHY物理层、以及实现自测所需要环形电路，所述环形电路处于与MIPIAPHY物理层并列的位置；所述协议层中包括本地协议从电路和本地协议主电路，所述协议适配层中包括本地协议转APHY协议适配电路和APHY协议转本地协议适配电路。本发明无需对接另一颗MIPIAPHY芯片，并且在单颗MIPIAPHY芯片上将两个方向上的本地协议电路和本地协议适配电路结合起来一起测验，简化芯片测试的外部环境，提升芯片测试的效率。

主权项：1.一种用于MIPIAPHY芯片的协议层及协议适配层自测电路，其特征在于，包括协议层、协议适配层、MIPIAPHY链路层和MIPIAPHY物理层、以及实现自测所需要环形电路，所述环形电路处于与MIPIAPHY物理层并列的位置；所述协议层中包括本地协议从电路和本地协议主电路，所述协议适配层中包括本地协议转APHY协议适配电路和APHY协议转本地协议适配电路；外部挂载的协议发送端向本地协议从电路发送协议数据，经过本地协议转APHY协议适配电路转换为MIPIAPHY协议数据，由MIPIAPHY链路层发往MIPIAPHY物理层，最终通过电缆送到外部的链接伙伴；链接伙伴接收到MIPIAPHY数据包后，依次经过MIPIAPHY物理层→MIPIAPHY链路层把数据包送到对应协议的APHY协议转本地协议适配电路，此时MIPIAPHY数据包中的上层协议信息被提取并还原成协议的格式，链接伙伴的本地协议主电路根据APHY协议转本地协议适配电路送来的信息将源头协议发送端的行为完全复刻出来发给协议接收端，完成一次完整的协议层活动；所述环形电路通过FIFO缓存方案和降速适配方案在下行链路方向和上行链路方向实现速率匹配；所述FIFO缓存方案为：所述环形电路包含一个用于缓存数据的FIFO和一套发送电路；该发送电路在传输速率和数据接口上完全匹配所对接的接收电路；用FIFO将MIPIAPHY链路层发送的MIPIAPHY数据包缓存下来，通过检测包头和包尾确认包完整性之后，调用环形电路内的发送电路将这笔MIPIAPHY数据包发回给MIPIAPHY链路层；发送速率匹配MIPIAPHY链路层的接收电路，因此MIPIAPHY链路层能成功解析这笔包；在下行链路方向的环形电路中，接收端的带宽高于发送端，需对FIFO做保护以防止溢出：当FIFO接收完一笔包后，立刻停止对FIFO的写入允许，直到FIFO里的包被发送出去；FIFO被清空后，才重新允许写入FIFO；在上行链路方向的环形电路中不需要做保护；所述降速适配方案为：每颗MIPIAPHY芯片的MIPIAPHY链路层内部都包括一套下行链路传输电路和一套上行链路传输电路，所述下行链路传输电路和所述上行链路传输电路的收发方向相反；对所述下行链路传输电路实施时钟降频手段，将其数据传输速率调整到与所述上行链路传输电路相同。

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