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申请/专利权人：奇捷科技(深圳)有限公司
申请日：2023-07-06
公开（公告）日：2023-08-04
公开（公告）号：CN116542191A
主分类号：G06F30/327
分类号：G06F30/327;G06F18/22;G06F30/394
优先权：
专利状态码：有效-授权
法律状态：2023.12.05#授权;2023.08.22#实质审查的生效;2023.08.04#公开
摘要：本申请涉及数字芯片设计技术领域，提供了逻辑更正方法、装置、设备及存储介质，其中，该方法通过逻辑设计阶段生成的初始RTL文件、对数字芯片的设计逻辑进行更改后，在所述逻辑设计阶段生成的目标RTL文件、在所述逻辑综合阶段基于所述初始RTL文件生成的通用技术网表、在所述逻辑综合阶段基于所述目标RTL文件生成的通用技术网表、在所述逻辑综合阶段基于所述初始RTL文件生成的门级网表、在所述逻辑综合阶段基于所述目标RTL文件生成的门级网表生成所述逻辑更正文本，并基于所述逻辑更正文本对所述第一门级网表进行更正，得到所述逻辑综合阶段的目标门级网表，提高了对逻辑综合阶段的初始门级网表进行更正的成功率。
主权项：1.一种逻辑更正方法，其特征在于，所述方法包括：获取第一RTL文件、第二RTL文件、第一通用技术网表、第二通用技术网表、第一门级网表、第二门级网表；其中，所述第一RTL文件为逻辑设计阶段生成的初始RTL文件，所述第二RTL文件为对数字芯片的设计逻辑进行更改后，在所述逻辑设计阶段生成的目标RTL文件，所述第一通用技术网表为在逻辑综合阶段基于所述第一RTL文件生成的通用技术网表，所述第二通用技术网表为在所述逻辑综合阶段基于所述第二RTL文件生成的通用技术网表，所述第一门级网表为在所述逻辑综合阶段基于所述第一RTL文件生成的门级网表，所述第二门级网表为在所述逻辑综合阶段基于所述第二RTL文件生成的门级网表；基于所述第一RTL文件、所述第二RTL文件、所述第一通用技术网表、所述第二通用技术网表生成初始逻辑更正文本；基于所述初始逻辑更正文本、所述第一门级网表、所述第二门级网表生成逻辑更正文本；基于所述逻辑更正文本对所述第一门级网表进行更正，得到所述逻辑综合阶段的目标门级网表。
全文数据：
权利要求：
百度查询： 奇捷科技(深圳)有限公司 逻辑更正方法、装置、设备及存储介质
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