申请/专利权人：苏州盛科通信股份有限公司

申请日：2020-09-17

公开（公告）日：2024-06-07

公开（公告）号：CN112115082B

主分类号：G06F13/32

分类号：G06F13/32

优先权：

专利状态码：有效-授权

法律状态：2024.06.07#授权;2021.08.10#著录事项变更;2021.01.08#实质审查的生效;2020.12.22#公开

摘要：本发明涉及一种DMA控制器及其数据传输方法，所述DMA控制器包括：检测描述符状态单元，用于当DMA控制器向CPU传输数据或者从CPU接收数据时，检测所述数据对应的描述符的状态指示位Done的值，所述DMA控制器基于所述检测结果对所述数据进行处理。通过在DMA控制器中增加检测描述符状态单元，在DMA控制器和CPU之间数据传输时，根据描述符的状态指示位Done进行操作，不需要关心主存和Cache之间是否同步，避免CPU收到中断后从进程的地址空间没有得到DMA控制器传输过来的数据而导致数据丢失，可大幅提升CPU和DMA控制器数据传输的性能。

主权项：1.一种直接存储器访问DMA控制器，其特征在于，所述DMA控制器包括：检测描述符状态单元，用于当DMA控制器向CPU传输数据或者从CPU接收数据时，检测所述数据对应的描述符的状态指示位Done的值，所述DMA控制器基于检测结果对所述数据进行处理；其中，所述状态指示位Done的值为0或1，Done=1表示描述符有效，Done=0表示描述符空闲；其中，所述DMA控制器向主存写完数据后，将中断寄存器的标志位置为1，以中断的方式通知CPU，所述CPU在收到中断后，调用相应的中断处理函数，并判断是否进行中断处理；若是，则将中断寄存器的标志位置为0，清除中断，并通过缓存Cache读取主存中的数据；所述DMA控制器还包括读写主存数据单元，当所述DMA控制器向所述CPU传输数据时，所述DMA控制器判断是否存在状态指示位Done=0的描述符；若不存在，则终止数据传输；若存在，则所述读写主存数据单元通过控制总线向所述描述符对应的主存的数据地址写入数据，所述DMA控制器将所述数据对应的描述符的状态指示位Done的值置为1；当所述CPU向所述DMA控制器传输数据时，所述CPU将所述数据承载在描述符的数据部分，并将所述描述符中的状态指示位Done的值置为1，所述DMA控制器中的所述检测描述符状态单元顺序扫描所述描述符，判断其状态指示位done的值是否为1；若是，则所述DMA控制器读取所述描述符的数据进行处理。

全文数据：

权利要求：

百度查询： 苏州盛科通信股份有限公司 一种DMA控制器及其数据传输方法

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