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申请/专利权人：ARM有限公司
申请日：2018-08-30
公开（公告）日：2024-06-14
公开（公告）号：CN111527479B
主分类号：G06F12/0888
分类号：G06F12/0888;G06F12/0897;G06F12/126;G06F12/0804;G06F12/0846;G06F12/0864;G06F12/14;G06F12/0862;G06F9/38;G06F21/57;G06F21/75;G06F12/0815
优先权：["20180110 GB 1800357.4"]
专利状态码：有效-授权
法律状态：2024.06.14#授权;2021.01.22#实质审查的生效;2020.08.11#公开
摘要：装置2包括：执行指令的推测性执行的处理电路4；主缓存存储区30；推测性缓存存储区32；以及缓存控制电路34，该缓存控制电路34在处理电路触发的推测性存储器访问保持推测性的情况下，将由推测性存储器访问引起的分配的条目分配给推测性缓存存储区而不是主缓存存储区。这能够帮助防止潜在的安全攻击，这些攻击利用缓存定时侧信道来获取关于由推测性存储器访问引起的对于缓存的分配的信息。
主权项：1.一种数据处理装置，包括：处理电路，用于执行指令的推测性执行；主缓存存储区；推测性缓存存储区；以及缓存控制电路，用于在所述处理电路触发的推测性存储器访问保持推测性的情况下，将所述推测性存储器访问引起分配的条目分配到所述推测性缓存存储区而不是所述主缓存存储区，其中：当触发所述条目到所述推测性缓存存储区的分配的所述推测性存储器访问是用于从存储器系统加载数据的推测性加载存储器访问时，响应于所述推测性加载存储器访问而分配到所述推测性缓存存储区的所述条目指定了从所述存储器系统加载的所述数据，所述缓存控制电路被配置为：在所述推测性存储器访问被解析为正确之后，将响应于推测性存储器访问而分配的条目从所述推测性缓存存储区传送到所述主缓存存储区，并且在所述处理电路从特权较高状态切换到其中所述处理电路不能访问在所述特权较高状态能访问的数据的特权较低状态之后，所述缓存控制电路被配置为：允许所述处理电路在所述特权较低状态中访问在所述主缓存存储区中所存储的条目；并且防止所述处理电路在所述特权较低状态中访问在所述推测性缓存存储区中所存储的在所述处理电路在所述特权较高状态中操作时分配给所述推测性缓存存储区的条目。
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