申请/专利权人：索尼集团公司

申请日：2022-10-21

公开（公告）日：2024-06-25

公开（公告）号：CN118251845A

主分类号：H03M13/19

分类号：H03M13/19;H04L27/26

优先权：["20211102 JP 2021-179128"]

专利状态码：在审-公开

法律状态：2024.06.25#公开

摘要：本技术涉及发送装置、发送方法、接收装置以及接收方法，利用该发送装置、发送方法、接收装置以及接收方法可以在使用LDPC编码的数据传输中确保良好的通信质量。基于码长N为1224或1152位并且编码率r为1441224或1441152的LDPC码的校验矩阵执行LDPC编码。校验矩阵包括由预定值M1和LDPC码信息长度K＝N×r表示的M1行和K列的A矩阵、M1行和M1列的阶梯结构的B矩阵、为M1行和N‑K‑M1列的零矩阵的Z矩阵、N‑K‑M1行和K+M1列的C矩阵、以及为N‑K‑M1行和N‑K‑M1列的单位矩阵的D矩阵。A矩阵和C矩阵由校验矩阵初始值表表示。校验矩阵初始值表是每36列表示A矩阵和C矩阵的一个元素的位置的预定表。例如，本技术可以用于使用LDPC编码的数据传输。

主权项：1.一种发送装置，包括：编码单元，基于码长N为1224位且编码率r为1441224的LDPC码的奇偶校验矩阵执行LDPC编码，其中，所述奇偶校验矩阵包括：由预定值M1和所述LDPC码的信息长度K＝N×r表示的M1行和K列的位于所述奇偶校验矩阵左上的A矩阵；M1行和M1列的与所述A矩阵的右侧相邻的阶梯结构的B矩阵；Z矩阵，所述Z矩阵是M1行和N-K-M1列的与所述B矩阵的右侧相邻的零矩阵；N-K-M1行和K+M1列的与所述A矩阵和所述B矩阵的下侧相邻的C矩阵；以及D矩阵，所述D矩阵是N-K-M1行和N-K-M1列的与所述C矩阵的右侧相邻的单位矩阵；所述预定值M1是108，通过奇偶校验矩阵初始值表表示所述A矩阵和所述C矩阵，所述奇偶校验矩阵初始值表是针对每36列表示所述A矩阵和所述C矩阵的1的元素的位置的表；并且73610716717335048951057764371678996097910611076537510333634939641448048849051355961062282710391369101108122277483532546587612710713858982102510327228242044148255378480897713917877880381310551305767097328279911091254039059981068。

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权利要求：

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