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申请/专利权人：华为技术有限公司
摘要：提供了一种堆叠式芯片组件，所述堆叠式芯片组件包括第一芯片101、201、第二芯片102、202和时钟分布网络104、204、210。所述第一芯片和所述第二芯片沿着所述第一芯片与所述第二芯片之间的接口103、203堆叠。所述时钟分布网络将时钟信号发送到所述第一芯片和所述第二芯片中的每个芯片中的一个或多个寄存器105、205。用于所述第一芯片的所述时钟信号的第一子时钟分布网络106、206部分地重新定位在所述第二芯片中，用于所述第二芯片的所述时钟信号的第二子时钟分布网络107、207部分地重新定位在所述第一芯片中，使得所述第一子时钟分布网络和所述第二子时钟分布网络中的每个子时钟分布网络至少通过所述接口一次。
主权项：1.一种堆叠式芯片组件，其特征在于，所述堆叠式芯片组件包括：第一芯片101、201和第二芯片102、202，沿着所述第一芯片101、201与所述第二芯片102、202之间的接口103、203堆叠；时钟分布网络104、204、210，用于将时钟信号发送到所述第一芯片101、201和所述第二芯片102、202中的每个芯片中的一个或多个寄存器105、205，其中用于所述第一芯片101、201的所述时钟信号的第一子时钟分布网络106、206部分地重新定位在所述第二芯片102、202中，用于所述第二芯片102、202的所述时钟信号的第二子时钟分布网络107、207部分地重新定位在所述第一芯片101、201中，使得所述第一子时钟分布网络106、206和所述第二子时钟分布网络107、207中的每个子时钟分布网络至少通过所述接口103、203一次。
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