申请/专利权人：杭州电子科技大学

申请日：2022-03-17

公开（公告）日：2024-05-14

公开（公告）号：CN114676005B

主分类号：G06F11/22

分类号：G06F11/22

优先权：

专利状态码：有效-授权

法律状态：2024.05.14#授权;2022.07.15#实质审查的生效;2022.06.28#公开

摘要：本发明公开了一种基于JTAG的FPGA图像分类加速器测试方法，包括如下步骤：S10、将测试图片转换成若干个mif文件；S11、控制JTAG向FPGA图像分类加速器板卡分多次传输测试图像；S12、每张测试图像分类完成后从FPGA板卡获取分类标签，将分类结果写入本地文件；S13、根据所述写有分类结果的本地文件与测试数据集标准结果进行对比，统计分类准确率。采用上述技术方案，提高FPGA图像分类加速器测试电路部署效率，免去使用复杂的通信接口与协议，同时降低加速器板卡的硬件需求，提高测试的效率。由于FPGA板卡均带有JTAG接口，因此无需其他通信接口就能快速搭建卷积神经网络加速器数据集测试平台，从而减少了存储和寄存器资源的消耗，同时测试效率有明显的提升。

主权项：1.一种基于JTAG的FPGA图像分类加速器测试方法，其特征在于，包括如下步骤：S10、将测试图片转换成若干个mif文件；S101、读取第a张图片，按像素平铺成长度为P*P*3的数据序列，其中P为图片的长和宽，3表示彩色图片RGB通道数，数据序列以RGB通道，行，列的顺序规则排序；S102、将上述序列分为若干个长度为nb的数据段，其中b为FPGA加速器设置的数据位宽；S103、将上述数据段组合为N个深度为m的数据块，数据不足部分补零处理；S104、将上述数据块按顺序写成mif文件，文件名命名为pic2mif_a_z.mif，其中z表示第z个数据块；S11、控制JTAG向FPGA图像分类加速器板卡分多次传输测试图像；S111、根据控制时序将N个mif文件依次更新至ROM；S112、控制时序使加速器板卡运行图片分类逻辑；S113、根据控制时序检测到图片分类完成后将结果寄存器RSLT_REG的值写入本地文件；4、所述控制时序的方法为：1当FPGA板卡上电复位或者一次图片分类逻辑结束时RSLT_VALID寄存器置1，当流程控制程序开始控制JTAG更新ROM中数据时RSLT_VALID寄存器置0；2当流程控制程序JTAG完成一次ROM数据更新时UPDATA_DONE寄存器置1，持续1个周期之后UPDATA_DONE寄存器置0；3当FPGA板卡中的UPDATA_DONE＝1且DATA_VALID＝0时DATA_VALID寄存器置1，直到检测到FPGA板卡中的RD_DONE＝1之后DATA_VALID寄存器置0；4当ROM中数据全部复制到内存之后RD_DONE寄存器置1，当RD_DONE＝1且流程控制程序开始控制JTAG更新ROM中数据时RD_DONE寄存器置0；5当流程控制程序更新完N个mif文件即一张完整的测试图片且RD_DONE＝1时START寄存器置1，持续一个时钟周期后START寄存器置0；6一次图片分类逻辑结束时寄存器RSLT_REG的值更新为当前分类结果；所述流程控制程序的方法如下：S40，初始化，文件索引值设置为0，跳转到S41；S41，控制JTAG持续读取RSLT_VALID，当读取值为1时，控制JTAG将当前文件索引值所对应mif文件更新到ROM，文件索引值加1，跳转到S42；S42，控制JTAG读取RSLT_REG，转换为十进制数result后以“*result”的格式续写到本地文件rslt_file，跳转到S43；S43，控制JTAG修改UPDATA_DONE为1，延迟1毫秒，控制JTAG修改UPDATA_DONE为0，若已累积更新N个mif文件，跳转到S41，否则跳转到跳转到S44；S44，控制JTAG持续读取RD_DONE，当读取值为1时，控制JTAG将当前文件索引值所对应mif文件更新到ROM，文件索引值加1，若索引文件不存在，跳转到S45，否则跳转到S43；S45，将rslt_file中记录的数据以“*”分割得到N+1个数据，舍弃掉第一个数据后与测试数据集标签进行比较，计算准确率，打印到屏幕，退出程序；S12、每张测试图像分类完成后从FPGA板卡获取分类标签，将分类结果写入本地文件；S13、根据所述写有分类结果的本地文件与测试数据集标准结果进行对比，统计分类准确率。

全文数据：

权利要求：

百度查询： 杭州电子科技大学 基于JTAG的FPGA图像分类加速器测试方法及系统

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