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申请/专利权人：北京显芯科技有限公司
摘要：本申请公开了一种时钟的校正方法及装置，涉及集成电路技术领域，用于降低锁相环小数杂散噪声，以提高锁相环的稳定性。该方法包括：时钟校正设备可以根据获取的模拟信号和目标分频系数确定第一序列。其中，第一序列可用于指示模拟信号对应的第一分频系数和第二分频系数。时钟校正设备可以根据第一序列确定一个鉴相周期中分频系数为第一分频系数的次数和第二分频系数的次数，并根据第一分频系数的次数和第二分频系数的次数获得校正时钟信号。其中，鉴相周期为分频周期的M倍。
主权项：1.一种时钟的校正方法，其特征在于，所述方法包括：获取模拟信号，并根据所述模拟信号和目标分频系数确定第一序列，所述第一序列用于指示所述模拟信号对应的第一分频系数和第二分频系数；根据所述第一序列确定一个鉴相周期中分频系数为所述第一分频系数的次数和分频系数为所述第二分频系数的次数，所述鉴相周期为分频周期的M倍，所述M为大于或等于2的整数；根据所述第一分频系数的次数和所述第二分频系数的次数获得校正时钟信号；发送所述校正时钟信号。
全文数据：
权利要求：
百度查询： 北京显芯科技有限公司 一种时钟的校正方法及装置
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