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申请/专利权人：北京全路通信信号研究设计院集团有限公司

摘要：本发明公开了一种基于UVM的应答器芯片多模块同步验证平台和验证方法，考虑到了应答器芯片工作过程中多个模块之间的联动，将应答器芯片的写码模块、读码模块和有源模块同时例化为待测设计DUT进行仿真验证，更加符合应答器芯片各个模块之间的相互配合运行关系，可以做到对实际环境的更贴近的仿真。把三个模块当成一个整体进行验证，相比于单独模块进行验证，把部分外部接口变成内部接口信号，减少了需要施加接口激励的数量，同时模块间信号配合更加密切，需要一个模块对另一个模块的配合输出，调试的时候需要联合观察信号，体现了应答器三个模块的协调一致工作；能够同时验证多个应答器芯片中的功能模块，能够提高应答器芯片的验证效率。

主权项：1.一种基于UVM的应答器芯片多模块同步验证平台，其特征在于，包括：激励序列生成模块，用于产生transaction数据包，其中，根据应答器的帧信息，配置所述transaction数据包；写代理器，用于从所述激励序列生成模块获取写码transaction数据包并驱动待验证应答器的写码模块，对所述待验证应答器的写码模块和读码模块进行仿真验证；有源代理器，用于从所述激励序列生成模块获取有源transaction数据包并驱动所述待验证应答器的有源模块，对所述有源模块进行仿真验证；检测器组件，用于采集所述待验证应答器输出的实际数据，并发送给计分板；所述检测器组件包括：EEPROM输入检测器，用于检测所述读码模块与应答器芯片的内存模块EEPROM之间端口的信号变化，并将输入到所述读码模块端口的信号级数据打包并恢复成transaction数据包级别后传递给所述计分板；读模块输出检测器，用于监视所述读码模块和所述有源模块的输出端口的信号变化，并将采集到的所述读码模块和所述有源模块的输出端口的信号级数据转变为transaction数据包级别并传递给所述计分板；参考模型组件，用于生成参考数据并发送给所述计分板；所述参考模型组件包括：读模型，用于完成所述写码模块和所述读码模块相同的功能，并输出对应的参考数据传递给所述计分板；有源模型，用于完成所述有源模块相同的功能，并输出对应于有源模块的参考数据传递给所述计分板；计分板，用于将所述实际数据与所述参考数据进行对比后获取所述待验证应答器的验证结果。

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