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申请/专利权人：意法半导体国际有限公司
申请日：2021-12-29
公开（公告）日：2024-06-21
公开（公告）号：CN114691583B
主分类号：G06F13/42
分类号：G06F13/42;G06F13/40
优先权：["20201230 US 63/132,297","20211210 US 17/548,101"]
专利状态码：有效-授权
法律状态：2024.06.21#授权;2022.07.19#实质审查的生效;2022.07.01#公开
摘要：本公开的实施例涉及用于将源同步数据路径与未知时钟相位对接的数据桥。集成电路包括第一子系统，第一子系统包括被配置为生成第一时钟信号的第一时钟发生器。集成电路还包括第二子系统，第二子系统包括被配置为生成第二时钟信号的第二时钟发生器。第一子系统包括时钟边沿选择器，时钟边沿选择器被配置为确定在第一时钟信号和第二时钟信号之间的相位差并且基于相位差，选择第二时钟信号的上升边沿或下降边沿来控制从第一子系统输出到第二子系统的数据。
主权项：1.一种用于集成电路的子系统之间的通信的方法，包括：利用所述集成电路的第一子系统来生成第一时钟信号；利用所述集成电路的第二子系统来生成第二时钟信号；确定在所述第一时钟信号与所述第二时钟信号之间的相位差；以及基于所述相位差来选择所述第二时钟信号的边沿；利用所述第二时钟信号的选定边沿来控制从所述第一子系统到所述第二子系统的数据传输；利用所述第一子系统来生成第一相位信号，所述第一相位信号具有与所述第一时钟信号相同的频率以及相对于所述第一时钟信号的第一选定相位差；以及利用所述第一子系统来生成第二相位信号，所述第二相位信号具有与所述第一时钟信号相同的所述频率以及相对于所述第一时钟信号的第二选定相位差。
全文数据：
权利要求：
百度查询： 意法半导体国际有限公司 用于将源同步数据路径与未知时钟相位对接的数据桥
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