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申请/专利权人：深圳市稳先微电子有限公司

摘要：本发明适用于电子技术领域，本发明提供的一种电压比较器、控制芯片及开关电源，所述电压比较器包括：输入电路、电流电压转化电路、电压嵌位电路和输出电路，通过在比较器中设置电压嵌位电路，在采样电压小于参考电压时，电压嵌位电路将第一级输入电路的输出端的第二节点电压控制在第一预设电压值，且第一预设电压值小于所述电源电压；在采样电压大于参考电压时，电流电压转化电路输出端的第一节点电压由零开始上升，电压嵌位电路将第一节点电压的上升峰值控制在第二预设电压值，第二预设电压值小于所述电源电压，由于第一节点电压和第二节点电压都不用上升到电源电压，缩短电压比较器的响应时间。

主权项：1.一种电压比较器，其特征在于，包括：输入电路、电流电压转化电路、电压嵌位电路和输出电路；所述输入电路的电源端、所述电流电压转化电路的电源端和所述输出电路的电源端均接入同一电源电压，所述电流电压转化电路的接地端和所述输出电路的接地端均接地；所述输入电路的第一输入端接入采样电压，输入电路的第二输入端接入参考电压；所述输入电路的第一输出端与所述电流电压转化电路的第一输入端连接，所述输入电路的第二输出端与所述电流电压转化电路的第二输入端连接；所述输出电路包括第一级输出电路和第二级输出电路，所述第一级输出电路的电源端和第二级输出电路的电源端均接入所述电源电压，所述第一级输出电路和第二级输出电路的接地端均接地，所述第一级输出电路的输出端与所述第二级输出电路的输入端连接，所述第二级输出电路的输出端输出控制电压；所述电流电压转化电路的输出端分别与所述第一级输出电路的输入端和所述电压嵌位电路的第一控制端连接，所述电压嵌位电路的第二控制端和第三控制端分别与所述第一级输出电路的输出端连接；在所述采样电压小于所述参考电压时，所述输入电路的第一输出端输出的第一电流信号大于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流信号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压为零，所述电压嵌位电路将所述第一级输出电路的输出端的第二节点电压控制在第一预设电压值，所述第一预设电压值小于所述电源电压，所述第二级输出电路的输出端的输出控制电压为零；在所述采样电压达到所述参考电压时，所述输入电路的第一输出端输出的第一电流信号小于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流信号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压由零开始上升，所述电压嵌位电路将所述第一节点电压的上升峰值控制在第二预设电压值，所述第二预设电压值小于所述电源电压，所述第一级输出电路的输出端的第二节点电压由所述第一预设电压值下降到零，所述第二级输出电路的输出端的输出控制电压为电源电压。

全文数据：电压比较器、控制芯片及开关电源技术领域[0001]本发明属于电子技术领域，尤其涉及一种电压比较器、控制芯片及开关电源。背景技术[0002]在AC-DC开关电源的控制芯片中，需要通过比较器来控制控制芯片输出控制信号，由于比较器从接收到输入信号到输出控制信号存在较长的响应时间，导致AC-DC系统中功率管在关断过程中存在较大的延时，进一步引起AC-DC开关电源中电感电流峰值的误差较大，最终引起AC-DC开关电源的输出端在不同的输入线电压下的负载能力变化较大，造成高输入线电压时，AC-DC开关电源的电感电流极易进入饱和状态，降低AC-DC开关电源的安全性。发明内容[0003]有鉴于此，本发明实施例提供了一种电压比较器、控制芯片及开关电源，能够快速响应并输出控制信号，能够有效降低从接受输入信号到输出控制信号的响应时间。[0004]本发明实施例的第一方面，提供了一种电压比较器，包括:输入电路、电流电压转化电路、电压嵌位电路和输出电路;所述输入电路的电源端、所述电流电压转化电路的电源端和所述输出电路的电源端均接入同一电源电压，所述电流电压转化电路的接地端和所述输出电路的接地端均接地;所述输入电路的第一输入端接入采样电压，输入电路的第二输入端接入参考电压;所述输入电路的第一输出端与所述电流电压转化电路的第一输入端连接，所述输入电路的第二输出端与所述电流电压转化电路的第二输入端连接;所述输出电路包括第一级输出电路和第二级输出电路，所述第一级输出电路的电源端和第二级输出电路的电源端均接入所述电源电压，所述第一级输出电路和第二级输出电路的接地端均接地，所述第一级输出电路的输出端与所述第二级输出电路的输入端连接，所述第二级输出电路的输出端输出控制电压;所述电流电压转化电路的输出端分别与所述第一级输出电路的输入端和所述电压嵌位电路的第一控制端连接，所述电压嵌位电路的第二控制端和第三控制端分别与所述第一级输出电路的输出端连接；[0005]在所述采样电压小于所述参考电压时，所述输入电路的第一输出端输出的第一电流信号大于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流信号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压为零，所述电压嵌位电路将所述第一级输入电路的输出端的第二节点电压控制在第一预设电压值，所述第一预设电压值小于所述电源电压，所述第二级输出电路的输出端的输出控制电压为零；[0006]在所述米样电压达到所述参考电压时，所述输入电路的第一输出端输出的第一电流信号大于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流丨目号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压由零开始上升，所述电压嵌位电路将所述第一节点电压的上升峰值控制在第二预设电压值，所述弟一预设电压值小于所述电源电压，所述第一级输入电路的输出端的第二节点电压由所述第一预设电压值下降到零，所述第二级输出电路的输出端的输出控制电压为电源电压。[0007]进一步地，所述电压嵌位电路包括:第一NMOS管和第二NMOS管；[000S]所述第一NMOS管的源极、所述第二NMOS管的漏极和所述第二NMOS管的栅极分别与所述电流电压转化电路的输出端连接，所述第一醒0S管的漏极、所述第一NMOS管的栅极和所述第二NMOS管的源极分别所述第一级输出电路的输出端连接。[0009]进一步地，所述输入电路包括:第一PM0S管、第二PM0S管和第三PM0S管;所述第一PM0S管的源极接入所述电源电压，所述第一PM0S管的漏极分别与所述第二PM0S管的源极和第三PM0S管的源极连接，所述第一PM0S管的栅极接入第一控制信号，所述第二PM0S管的栅极接入所述采样电压，所述第三PM0S管的栅极接入所述参考电压，所述第二PM0S管的漏极与所述电流电压转化电路的第一输入端连接，所述第三PM0S管的漏极与所述电流电压转化电路的第二输入端连接。[0010]进一步地，所述电流电压转化电路包括:第四PM0S管、第5PM0S管、第六PM〇s管、第七PM0S管、第三NMOS管、第四NMOS管、第五NMOS管以及第六NMOS管;所述第四PM0S管的源极和所述第五PM0S管的源极均接入所述电源电压，所述第四PM0S管的漏极和栅极分别与所述第五PM0S管的栅极连接，所述第四PM0S管的漏极和栅极分别与所述第六PM0S管的源极连接，所述第五PM0S管的漏极与所述第七PM0S管的源极连接，所述第六PM0S管的漏极和栅极分别所述第七PM0S管的栅极连接;所述第三NMOS管的漏极分别与所述第六PM0S管的漏极和栅极的连接，所述第四NMOS管的漏极与所述第七PM0S管的漏极连接;所述第三NMOS管的源极与所述第五NMOS管的漏极连接，所述第四NMOS管的源极与第六NMOS管的漏极连接，所述第三NMOS管的栅极和第四NMOS管的栅极均接入第二控制信号;所述第五NMOS管的源极和第六匪0S管的源极分别接地，所述第五NMOS管的栅极和第六NMOS管的栅极均接入第三控制信号;所述第三NMOS管的源极与所述第五NMOS管的漏极的共接点为所述电流电压转化电路的第一输入端，所述第四NMOS管的源极与所述第六NMOS管的漏极的共接点为所述电流电压转化电路的第二输入端，所述第四NM〇S管的漏极与所述第七PM0S管的漏极的共接点为所述电流电压转化电路的输出端。[0011]进一步地，所述第一级输出电路包括第八PM0S管和第七NM0S管，所述第二级输出电路包括第九PM0S管和第八NMOS管;所述第八PM0S管的源极和所述第九PM0S管的源极均接入所述电源电压，所述第八PM0S管的漏极与所述第七NMOS管的漏极连接，所述第九PM0S管的漏极与所述第八麵0S管的漏极连接，所述第八PM0S管的栅极和所述第九PM0S管的栅极均接入第四控制信号;所述第七匪0S管的源极和所述第八NM0S管的源极均接地;所述第七NMOS管的栅极为所述第一级输出电路的输入端，所述第八PM0S管的漏极与所述第七NM0S管的漏极共接点为所述第一级输出电路的输出端，所述第八画os管的栅极为所述第二级输出电路的输入端，所述第九PM0S管的漏极与所述第八NMOS管的漏极的共接点为所述第二级输出电路的输出端。[0012]进一步地，所述第一级输出电路还包括:第一反相器和第二反相器，所述第一反相器与所述第二反相器串联，所述第一反相器的输入端接入所述第九1^08管的漏极与所述第八NM0S管的漏极的共接点。[0013]本发明实施例的第二方面，提供了一种控制芯片，包括:包括上述的电压比较器，还包括:与门、或非门、PWM模块、驱动电路、采样电阻和功率管；[0014]所述电压比较器的输出端与所述与门的第一输入端连接，所述与门的第二输入端接入LEB屏蔽信号，所述与门的输出端与所述PWM模块的第一输入端连接;所述或非门的第一输入端接入OSC时钟信号，所述或非门的第一输入端接地，所述或非门的输出端与所述PWM模块的第二输入端连接;所述PWM模块的输出端与所述驱动电路的输入端连接，所述驱动电路的输出端与所述功率管的栅极连接，所述功率管的漏极接入输入电压，所述功率管的源极与所述采样电阻的一端连接，所述采样电阻的另一端接地，所述功率管的源极与所述采样电阻的共接点与所述电压比较器的第一输入端连接。[0015]进一步地，所述功率管为NM0S管。[0016]本发明实施例的第三方面，提供了一种开关电源，包括上述的控制芯片，还包括：输入电容、芯片供电电容、储能电感、续流二极管、输出反馈二极管、输出电容及负载电阻；[0017]所述控制芯片的功率管的漏极为所述控制芯片的第一输入端，所述控制芯片还包括第二输入端，用于接入为控制芯片供电的电源，所述控制芯片的采样电阻的接地端为所述控制芯片的接地端；[0018]所述输入电容的一端接入供电电压，所述输入电容的另一端接地;所述控制芯片第一输入端接入输入电压，所述控制芯片的第二输入端与所述输出反馈二极管的阴极连接，所述控制芯片的接地端与所述储能电感的一端连接，所述储能电感的另一端与所述输出反馈二极管的阳极连接；[0019]所述芯片供电电容接在所述控制芯片的第二输入端与所述输出反馈二极管阴极的共接点与所述控制芯片的接地端与所述储能电感的共接点之间;所述续流二极管的阴极接入所述芯片供电电容与储能电感的共接点，所述续流二极管的阳极接地;所述输出电容与所述负载电阻并联的一端接入所述储能电感与输出反馈二极管的共接点，所述输出电容与所述负载电阻并联的另一端接地，所述负载电阻的两端为所述开关电源的输出端。[0020]进一步地，所述供电电压为交流电压，所述开关电源的输出端为输出直流电的正负极输出端。[0021]本发明实施例与现有技术相比的有益效果是:本发明实施例提供的一种电压比较器、控制芯片及开关电源，通过在比较器中设置电压嵌位电路，在采样电压小于参考电压时，电压嵌位电路将第一级输入电路的输出端的第二节点电压控制在第一预设电压值，且第一预设电压值小于所述电源电压;在采样电压大于参考电压时，电流电压转化电路输出端的第一节点电压由零开始上升，电压嵌位电路将第一节点电压的上升峰值控制在第二预设电压值，第二预设电压值小于所述电源电压，由于第一节点电压和第二节点电压都不用上升到电源电压，缩短电压比较器的响应时间。附图说明[0022]为了更清楚地说明本发明实施例中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。[0023]图1为本发明实施例提供的一种电压比较器的模块结构示意图；[0024]图2为本发明实施例提供的一种电压比较器的电路结构示意图；[0025]图3为本发明实施例提供的一种控制芯片的电路结构示意图；[0026]图4为本发明实施例提供的一种开关电源的电路结构示意图；[0027]图5为本发明实施例提供的理想状态的AC-DC开关电源电感电流的波形图；[0028]图6为本发明实施例提供的实际状态的AC-DC开关电源电感电流的波形图；[0029]图7为本发明实施例提供的高、低输入线电压下的开关电源的电感电流的波形图；[0030]图8本发明实施例提供的不同输入电压与过载保护点的对应关系示意图。具体实施方式[0031]以下描述中，为了说明而不是为了限定，提出了诸如特定系统结构、技术之类的具体细节，以便透彻理解本发明实施例。然而，本领域的技术人员应当清楚，在没有这些具体细节的其它实施例中也可以实现本发明。在其它情况中，省略对众所周知的系统、装置、电路以及方法的详细说明，以免不必要的细节妨碍本发明的描述。[0032]应当理解，当在本说明书和所附权利要求书中使用时，术语“包括”和“包含”指示所描述特征、整体、步骤、操作、元素和或组件的存在，但并不排除一个或多个其它特征、整体、步骤、操作、元素、组件和或其集合的存在或添加。[0033]还应当理解，在此本发明说明书中所使用的术语仅仅是出于描述特定实施例的目的而并不意在限制本发明。如在本发明说明书和所附权利要求书中所使用的那样，除非上下文清楚地指明其它情况，否则单数形式的“一”、“一个”及“该”意在包括复数形式。[0034]还应当进一步理解，在本发明说明书和所附权利要求书中使用的术语“和或”是指相关联列出的项中的一个或多个的任何组合以及所有可能组合，并且包括这些组合。[0035]如在本说明书和所附权利要求书中所使用的那样，术语“如果”可以依据上下文被解释为“当…时”或“一旦”或“响应于确定”或“响应于检测到”。类似地，短语“如果确定”或“如果检测到[所描述条件或事件]”可以依据上下文被解释为意指“一旦确定”或“响应于确定”或“一旦检测到[所描述条件或事件]”或“响应于检测到[所描述条件或事件]”。[0036]为了说明本发明所述的技术方案，下面通过具体实施例来进行说明。[0037]参考图1，图1为本发明实施例提供的一种电压比较器的模块结构示意图。为了便于说明，仅示出了与本发明相关的部分，本实施例的电压比较器100包括:输入电路1〇、电流电压转化电路20、电压嵌位电路30和输出电路40。[0038]输入电路10的电源端、电流电压转化电路20的电源端和输出电路40的电源端均接入电源电压VDD。电流电压转化电路2〇的接地端和输出电路40的接地端均接地GND。输入电路10的第一输入端101接入采样电压VRcs，输入电路1〇的第二输入端1〇2接入参考电压Vref。输入电路10的第一输出端1〇3与电流电压转化电路20的第一输入端201连接，输入电路10的第二输出端104与电流电压转化电路的第二输入端202连接。[0039]输出电路40包括第一级输出电路410和第二级输出电路42〇。第一级输出电路41〇的电源端和第二级输出电路42〇的电源端均接入电源电压，第一级输出电路41〇和第二级输出电路4加的接地端均接地。第一级输出电路410的输出端与第二级输出电路42〇的输入端连接，第二级输出电路42〇的输出端输出控制电压。电流电压转化电路2〇的输出端分别与第一级输出电路410的输入端连接。电压嵌位电路30的第一控制端3〇1与电流电压转化电路2〇的湔出3而连接，电压欣位电路30的第二控制端302和第三控制端303与第一级输出电路41〇的输出端连第二级输出电路420的输出端为电压比较器的输出端。[0040]^在米样电压VRcs小于参考电压Vref时，输入电路1〇的第一输出端1〇3输出的第—，流信号=于输入电路10第二输出端i〇4输出的第二电流信号，电流电压转化电路2〇根据第一电流信号和第二电流信号控制电流电压转化电路20输出端的第一节点电压v〇1为零，电压嵌位电路30将第一级输入电路41〇的输出端的第二节点电压¥〇2控制在第一预设电压值，第一预设电压值小于电源电压，第二级输出电路的输出端输出的控制电压¥〇3为零。、[0041]在采样电压VRcs达到参考电压Vref时，输入电路10的第一输出端103输出的第一电流信号=于输入电路10第二输出端104输出的第二电流信号，电流电压转化电路2〇根据第一电流彳目号和第二电流信号控制电流电压转化电路20输出端的第一节点电压v〇丨由零开始上升，电压嵌位电路30将第一节点电压v〇l的上升峰值控制在第二预设电压值，第二预设电压值小于电源电压，第一级输入电路410的输出端的第二节点电压vo2由第一预设电压值下降到零，第一级输出电路410的输出端的输出控制电压v〇3为电源电压。[0042]需要说明的是:本实施例中的第一预设电压值和第二预设电压值可以不同，也可以相同，例如第一预设电压值和第二预设电压值等于或约等于电源电压的一半。[0043]从上述实施例可知，通过在比较器中设置电压嵌位电路，在采样电压小于参考电压时，电压嵌位电路将第一级输入电路的输出端的第二节点电压控制在第一预设电压值，且第一预设电压值小于所述电源电压;在采样电压大于参考电压时，电流电压转化电路‘出端的第一节点电压由零开始上升，电压嵌位电路将第一节点电压的上升峰值控制在第二预设电压值，第二预设电压值小于所述电源电压，由于第一节点电压和第二节点电压都不用上升到电源电压，就能够使得比较器输出控制电压，缩短电压比较器的响应时间。[0044]参考图2,图2为本发明实施例提供的一种电压比较器的电路结构示意图。为了便于说明，仅示出了与本发明相关的部分，详述如下：。[0045]作为本发明的一个优选实施例，电压嵌位电路30包括:第一NMOS管31和第二NM0S管32。一[0046]第一NM0S管31的源极、第二NM0S管32的漏极和第二NM0S管32的栅极分别与电流电压转化电路20的输出J而连接，弟一NM0S管31的漏极、第一NM0S管31的棚极和第二醒〇s管32的源极分别第一级输出电路410的输出端连接。[0047]作为本发明的一个优选实施例，输入电路10包括:第一柯^⑻管^、第二PM0S管12和第三PM0S管13。[0048]第一PMOS管11的源极接入电源电压，第一PM0S管11的漏极分别与第二卩河⑽管以的源极和第三PM0S管13的源极连接，第一PM0S管11的栅极接入第一控制信号vbl;第二PM〇s管12的栅极接入采样电压，第三PM0S管I3的栅极接入参考电压;第二四05管12的漏极与电流电压转化电路20的第一输入端连接，第三PM0S13管的漏极与电流电压转化电路2〇的第二输入端连接。[0049]作为本发明的一个优选实施例，电流电压转化电路20包括:第四PM0S管21、第五PM0S管22、第六PM0S管23、第七PM0S管24、第三NM0S管25、第四NM0S管26、第五NM0S管27以及第六NM0S管28。[0050]第四PM0S管21的源极和第五PM0S管22的源极均接入电源电压，第四PM〇s管21的漏极和栅极分别于第五PMOS管22的栅极连接，第四PMOS管21的漏极和栅极分别与第六PM0S管23的源极连接，第五PM0S管22的漏极与第七PM0S管24的源极连接，第六PM0S管23的漏极和栅极分别与第七PMOS管24的栅极连接；[0051]第三NM0S管25的漏极分别与第六PMOS管23的漏极和栅极的连接，第四NM0S管26的漏极与第七PMOS管24的漏极连接;第三NM0S管25的源极与第五NM0S管27的漏极连接，第四NM0S管26的源极与第六NM0S管28的漏极连接，第三NM0S管25的栅极和第四NM0S管26的栅极均接入第二控制信号vb2;第五NM0S管27的源极和第六NM0S管28的源极分别接地，第五NM0S管27的栅极和第六NM0S管28的栅极均接入第三控制信号vb3;[OO52]第三NM0S管25的源极与第五NM0S管27的漏极的共接点为电流电压转化电路20的第一输入端，第四NM0S管26的源极与第六NM0S管28的漏极的共接点为电流电压转化电路20的第二输入端，第四NM0S管26的漏极与第七PM0S管24的漏极的共接点为电流电压转化电路20的输出端。[0053]作为本发明的一个优选实施例，第一级输出电路410包括第八PM0S管411和第七NM0S管412;第二级输出电路420包括第九PM0S管421和第八NM0S管422。[0054]第八PM0S管411的源极和第九PM0S管421的源极共接入电源电压，第八PM0S管411的漏极与第七NM0S管412的漏极连接，第九PM0S管421的漏极与第八NM0S管422的漏极连接，第八PM0S管411的栅极和第九PM0S管421的栅极共接入第四控制信号vb4;第七NM0S管412的源极和第八NM0S管422的源极共接地。[0055]第七NM0S管412的栅极为第一级输出电路410的输入端，第八PM0S管411的漏极与第七NM0S管412的漏极共接点为第一级输出电路410的输出端，第八NM0S管422的栅极为第二级输出电路420的输入端，第九PM0S管421的漏极与第八NM0S管422的漏极的共接点为第二级输出电路420的输出端。[0056]作为本发明的一个优选实施例，上述的第一级输出电路，还可以包括:第一反相器A1和第二反相器A2,所述第一反相器A1与所述第二反相器A2串联，所述第一反相器A1的输入端接入所述第九PM0S管421的漏极与所述第八NM0S管422的漏极的共接点。[0057]需要说明的是:本发明实施例提供的电压比较器的延时时间为25nS，远远小于普通电压比较器的53.5nS的延时时间。[0058]参考图2和3,图3为本发明实施例提供的一种控制芯片的电路结构示意图。为了便于说明，仅示出了与本发明相关的部分，本实施例的控制芯片200包括:上述实施例的电压比较器100、与门210、或非门220、PWM模块230、驱动电路240、采样电阻Rcs250和功率管260。[0059]电压比较器100的输出端与与门210的第一输入端连接，与门210的第二输入端接入LEB屏蔽信号，与门210的输出端与PWM模块230的第一输入端连接。或非门220的第一输入端接入0SC时钟信号，或非门220的第一输入端接地GND，或非门220的输出端与而M模块230的第二输入端连接;PWM模块230的输出端与驱动电路240的输入端连接，驱动电路240的输出端与功率管260的栅极连接。功率管260的漏极接入输入电压，功率管260的源极与采样电阻Rcs250的一端连接，采样电阻250的另一端接地，功率管260的源极与采样电阻250的共接点与电压比较器1〇〇的第一输入端连接。驱动电路为电压放大电路，功率管260为NM0S管。[0060]参考图3和4,图4为本发明实施例提供的一种开关电源的电路结构示意图。为了便于说明，仅示出了与本发明相关的部分，本实施例的开关电源300包括:控制芯片200、输入电容310、心片供电电容320、储能电感33〇、续流_•极管340、输出反馈二极管350、输出电容360及负载电阻370。、'[0061]控制心片200的功率管230的漏极为控制芯片的第一输入端VIN，控制芯片200还包括第二输入端VCC，用于接入为控制芯片200供电的电源，控制芯片2〇〇的采样电阻250的接地端为控制芯片200的接地端GND。[0062]输入电容310的一端接入供电电压，输入电容的另一端接地;控制芯片2〇〇第一输入端VIN接入输入电压，控制芯片2〇〇的第二输入端VCC与输出反馈二极管350的阴极连接，控制芯片200的接地端GND与储能电感330的一端连接，储能电感330的另一端与输出反馈二极管350的阳极连接。[0063]芯片供电电容32〇接在控制芯片2〇〇的第二输入端与输出反馈二极管35〇阴极的共接点与控制芯片200的接地端与储能电感330的共接点之间。续流二极管340的阴极接入芯片供电电容32〇与储能电感33〇的共接点，续流二极管：340的阳极接地。输出电容360与负载电阻370并联的一端接入储能电感3：3〇与输出反馈二极管350的共接点，输出电容360与负载电阻370并联的另一端接地，负载电阻37〇的两端为所述开关电源的输出端。其中供电电压为交流电压，负载电阻370的两端分别为开关电源3〇〇的正负极输出端。[0064]在一个具体应用实例中，电源开关可以为BUCK型AC-DC开关电源。参考图3和4，功率管260的开启是由内部的时钟信号〇SC控制PWM模块230输出开启信号开打开的；功率管260的关闭是由比较器100通过米样Rcs检测到VRCs达到参考电压Vref时，比较器100输出关断控制信号到P丽模块230，PWM模块230输出复位信号来关断功率管260。功率管260关闭时，储能电感330的电感电流值I〇cp=VrefRCS。[0065]对于一个理想状态的AC-DC开关电源，储能电感电感电流的波形如图5所示:其中Ii和分别为高、不同的输入线电压供电电压下对应的上升斜率不同的电流波形，其峰值与内部设置的Iocp的阈值完全一致，且可以表示为IL=vL*T，其中V是AC-D开关电源的输入线电压，L是储能电感330的电感量，T是在一个开关周期内储能电感的电感电流值从初始点上升到Iocp所需要的时间。[0066]对于一个实际状态的AC-DC开关电源，储能电感的电感电流可以表示为：lL=VL*T+VL*Td，其中，Td是电感电流达到I〇cp时相当于采样电压VRcs达到参考电压Vref到功率管关断之间的延时。由于Td存在，储能电感的电感电流为产生A1=VLTd的误差，且误差与输入线电压及延时Td成正比例关系，对于一个已知的AC-DC开关电源来说Td是固定的。参考图6,实际状态下储能电感的电感电流的波形，可知输入线电压越大，电感电流误差越大，输入线电压越小电感电流误差越小。[0067]其中，Td=Tcomp+Tds，式中Tcomp为电压比较器的相应时间，Tds为比较器输出关断控制信号Vcomp到功率管260的栅极所需要的时间。由于Tds的主要有逻辑电路（电压比较器1〇〇、与门210、或非门220、PWM模块230和驱动电路的延时组成，因此没有太大的优化空间。电压比较器的相应时间Tcomp对Td的作用更大。[0068]对于实际状态下的AC-DC开关电源，当输出负载从小到大变化时，电感电流将从DCMDiscontinuousCurrentMode，电流断续模式）模式进入到CCMContinuousCurrentMode，电流连续模式模式。参考图7,当输入线电压较小时，由于上述Tcomp引起的电感电流误差AIu较小，Ili的在CCM时期的峰值电流lpeakl具有较好的一致性；当输入线电压较大时，由于上述Tcomp引起的电感电流误差AIl2较大，Il2的在CCM时期的峰值电流Ipeak2的一致性较差。可知，在输入线电压较高时，每个开关周期向储能电感存储的能量大于输入线电压较低时存储的能量，从而导致系统输出端的负载能力在低输入线电压时较小，稿输入线电压是较大。[0069]参考图8,图8为电压比较器的不同的输入电压VI、输入电压V2和输入电压V3的过载11oad保护点的对应关系。其中，11oad1和11oad2为普通比较器的过载保护点；11oad1和Iload2为本发明实施例的电压比较器的过载保护点。可见本发明实施例提供的电压比较器能够使得开关电源的过载保护点到到很好的一致性，增强开关电源的安全性。普通比较器的延时时间为53.5nS，本发明的比较器的延时时间为25nS。可见本发明的比较器，大大提高了响应速度。[0070]以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到各种等效的修改或替换，这些修改或替换都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以权利要求的保护范围为准。

权利要求：1.一种电压比较器，其特征在于，包括:输入电路、电流电压转化电路、电压嵌位电路和输出电路；所述输入电路的电源端、所述电流电压转化电路的电源端和所述输出电路的电源端均接入同一电源电压，所述电流电压转化电路的接地端和所述输出电路的接地端均接地;所述输入电路的第一输入端接入采样电压，输入电路的第二输入端接入参考电压;所述输入电路的第一输出端与所述电流电压转化电路的第一输入端连接，所述输入电路的第二输出端与所述电流电压转化电路的第二输入端连接；所述输出电路包括第一级输出电路和第二级输出电路，所述第一级输出电路的电源端和第二级输出电路的电源端均接入所述电源电压，所述第一级输出电路和第二级输出电路的接地端均接地，所述第一级输出电路的输出端与所述第二级输出电路的输入端连接，所述第二级输出电路的输出端输出控制电压;所述电流电压转化电路的输出端分别与所述第一级输出电路的输入端和所述电压嵌位电路的第一控制端连接，所述电压嵌位电路的第二控制端和第三控制端分别与所述第一级输出电路的输出端连接；在所述采样电压小于所述参考电压时，所述输入电路的第一输出端输出的第一电流信号大于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流信号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压为零，所述电压嵌位电路将所述第一级输入电路的输出端的第二节点电压控制在第一预设电压值，所述第一预设电压值小于所述电源电压，所述第二级输出电路的输出端的输出控制电压为零；在所述采样电压达到所述参考电压时，所述输入电路的第一输出端输出的第一电流信号大于所述输入电路第二输出端输出的第二电流信号，所述电流电压转化电路根据所述第一电流信号和第二电流信号控制所述电流电压转化电路输出端的第一节点电压由零开始上升，所述电压嵌位电路将所述第一节点电压的上升峰值控制在第二预设电压值，所述第二预设电压值小于所述电源电压，所述第一级输入电路的输出端的第二节点电压由所述第一预设电压值下降到零，所述第二级输出电路的输出端的输出控制电压为电源电压。2.根据权利要求1所述的电压比较器，其特征在于，所述电压嵌位电路包括:第一丽0S管和第二NMOS管；所述第一NMOS管的源极、所述第二NMOS管的漏极和所述第二NM〇s管的栅极分别与所述电流电压转化电路的输出端连接，所述第一醒0S管的漏极、所述第一NM0S管的栅极和所述第二NMOS管的源极分别所述第一级输出电路的输出端连接。3.根据权利要求1所述的电压比较器，其特征在于，所述输入电路包括:第一pM0S管、第二PM0S管和第三PM0S管；所述第一PM0S管的源极接入所述电源电压，所述第一PM0S管的漏极分别与所述第二PM0S管的源极和第三PM0S管的源极连接，所述第一PM0S管的栅极接入第一控制信号，所述第二PM0S管的栅极接入所述采样电压，所述第三PM0S管的栅极接入所述参考电压，所述第二PM0S管的漏极与所述电流电压转化电路的第一输入端连接，所述第三pM〇s管的漏极与所述电流电压转化电路的第二输入端连接。4.根据权利要求1所述的电压比较器，其特征在于，所述电流电压转化电路包括:第四PM0S管、第五PM0S管、第六PM0S管、第七PM0S管、第三NMOS管、第四NMOS管、第五NMOS管以及第六NMOS管；所述第四PM0S管的源极和所述第五PM0S管的源极均接入所述电源电压，所述第四PMOS管的漏极和栅极分别与所述第五PM0S管的栅极连接，所述第四PM0S管的漏极和栅极分别与所述第六PM0S管的源极连接，所述第五PM0S管的漏极与所述第七PM0S管的源极连接，所述第六PM0S管的漏极和栅极分别与所述第七PM0S管的栅极连接；所述第三NM0S管的漏极分别与所述第六PM0S管的漏极和栅极的连接，所述第四NM0S管的漏极与所述第七PM0S管的漏极连接;所述第三NM0S管的源极与所述第五NM0S管的漏极连接，所述第四画0S管的源极与第六NM0S管的漏极连接，所述第三NM0S管的栅极和第四NM0S管的栅极均接入第二控制信号;所述第五NM〇S管的源极和第六NM0S管的源极分别接地，所述第五NM0S管的栅极和第六NM0S管的栅极均接入第三控制信号；所述第三NM0S管的源极与所述第五NM0S管的漏极的共接点为所述电流电压转化电路的第一输入端，所述第四NM0S管的源极与所述第六NM0S管的漏极的共接点为所述电流电压转化电路的第二输入端，所述第四NM〇S管的漏极与所述第七PM0S管的漏极的共接点为所述电流电压转化电路的输出端。5.根据权利要求1所述的电压比较器，其特征在于，所述第一级输出电路包括第八PM0S管和第七NM0S管，所述第二级输出电路包括第九PM0S管和第八NM0S管；所述第八PM0S管的源极和所述第九PM0S管的源极均接入所述电源电压，所述第八PM0S管的漏极与所述第七NM0S管的漏极连接，所述第九PM0S管的漏极与所述第八NM0S管的漏极连接，所述第八PM0S管的栅极和所述第九PM0S管的栅极均接入第四控制信号；所述第七NM0S管的源极和所述第八NM0S管的源极均接地；所述第七丽0S管的栅极为所述第一级输出电路的输入端，所述第八PM0S管的漏极与所述第七NM0S管的漏极共接点为所述第一级输出电路的输出端，所述第八NM0S管的栅极为所述第二级输出电路的输入端，所述第九PM0S管的漏极与所述第八NM0S管的漏极的共接点为所述第二级输出电路的输出端。6.根据权利要求5所述的电压比较器，其特征在于，所述第一级输出电路还包括:第一反相器和第二反相器，所述第一反相器与所述第二反相器串联，所述第一反相器的输入端接入所述第九PM0S管的漏极与所述第八NM0S管的漏极的共接点。7.—种控制芯片，其特征在于，包括如权利要求1至6任一项所述的电压比较器，还包括:与门、或非门、PWM模块、驱动电路、采样电阻和功率管；所述电压比较器的输出端与所述与门的第一输入端连接，所述与门的第二输入端接入LEB屏蔽信号，所述与门的输出端与所述PWM模块的第一输入端连接;所述或非门的第一输入端接入0SC时钟信号，所述或非门的第一输入端接地，所述或非门的输出端与所述PWM模块的第二输入端连接;所述PWM模块的输出端与所述驱动电路的输入端连接，所述驱动电路的输出端与所述功率管的栅极连接，所述功率管的漏极接入输入电压，所述功率管的源极与所述采样电阻的一端连接，所述采样电阻的另一端接地，所述功率管的源极与所述采样电阻的共接点与所述电压比较器的第一输入端连接。8.根据权利要求7所述的控制芯片，其特征在于，所述功率管为NM0S管。9.一种开关电源，其特征在于，包括如权利要求7或8任一项所述的控制芯片，还包括：输入电容、芯片供电电容、储能电感、续流二极管、输出反馈二极管、输出电容及负载电阻；所述控制芯片的功率管的漏极为所述控制芯片的第一输入端，所述控制芯片还包括第二输入端，用于接入为控制芯片供电的电源，所述控制芯片的采样电阻的接地端为所述控制芯片的接地端；所述输入电容的一端接入供电电压，所述输入电容的另一端接地;所述控制芯片第一输入端接入输入电压，所述控制芯片的第二输入端与所述输出反馈二极管的阴极连接，所述控制芯片的接地端与所述储能电感的一端连接，所述储能电感的另一端与所述输出反馈二极管的阳极连接；所述芯片供电电容接在所述控制芯片的第二输入端与所述输出反馈二极管阴极的共接点与所述控制芯片的接地端与所述储能电感的共接点之间;所述续流二极管的阴极接入所述芯片供电电容与储能电感的共接点，所述续流二极管的阳极接地;所述输出电容与所述负载电阻并联的一端接入所述储能电感与输出反馈二极管的共接点，所述输出电容与所述负载电阻并联的另一端接地，所述负载电阻的两端为所述开关电源的输出端。10.根据权利要求9所述的开关电源，其特征在于，所述供电电压为交流电压，所述开关电源的输出端为输出直流电的正负极输出端。

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